IP FPGA Intel eCPRI
eCPRI Intel® FPGA IP Note sulla versione
Il numero di versione IP Intel® FPGA (XYZ) può cambiare con ciascuna versione del software Intel Quartus® Prime. Un cambiamento in:
- X indica una revisione importante dell'IP. Se aggiorni il software Intel Quartus Prime, devi rigenerare l'IP.
- Y indica che l'IP include nuove funzionalità. Rigenera il tuo IP per includere queste nuove funzionalità.
- Z indica che l'IP include modifiche minori. Rigenera il tuo IP per includere queste modifiche.
- Introduzione ai core IP FPGA Intel
- eCPRI Guida per l'utente Intel FPGA IP
- eCPRI Intel FPGA IP Design Esample Guida per l'utente
eCPRI Intel FPGA IP v2.0.1
Tabella 1. v2.0.1 2022.11.15
| Versione Intel Quartus Prime | Descrizione | Impatto |
|
22.3 |
Aggiunto supporto per il seguente grado di dispositivo Intel Agilex™ e grado di velocità:
• Grado del dispositivo: industriale • Grado di velocità: -3 |
— |
eCPRI Intel FPGA IP v2.0.0
Tabella 2. v2.0.0 2022.08.26
| Versione Intel Quartus Prime | Descrizione | Impatto |
|
22.2 |
Aggiunto il supporto per lo schema di arbitrato dei pacchetti prioritari CoS L2 basato sulla specifica del piano di controllo, utente e sincronizzazione O-RAN 7.01 (ORAN-WG4.CUS.0-v07.01), Sezione 5.3 Qualità del servizio. |
— |
| Aggiunto supporto per il meccanismo di identificazione del flusso di dati basato sulle specifiche del piano di controllo, utente e sincronizzazione O-RAN
7.01 (ORAN-WG4.CUS.0-v07.01), Sezione 5.4 Identificazione del flusso di dati. |
— |
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| Aggiunto nuovo segnale: | — |
| Versione Intel Quartus Prime | Descrizione | Impatto |
| • tx_queue__fifo_full | ||
| • ext_source_pkt_type | ||
| • ext_tx_ingress_timestamp_96b_dati | ||
| • ptp_tx_ingress_timestamp_96b_dati | ||
| Aggiunti nuovi parametri IP: | ||
| • ID VLAN predefinito | ||
| • Meccanismo di elaborazione del flusso di dati | ||
| • Schema di arbitrato dei pacchetti | ||
| • Priorità predefinita dei pacchetti TX | ||
| • Profondità coda arbitrato TX 0 | ||
| • Profondità coda arbitrato TX 1 | — | |
| • Profondità coda arbitrato TX 2 | ||
| • Profondità coda arbitrato TX 3 | ||
| • Profondità coda arbitrato TX 4 | ||
| • Profondità coda arbitrato TX 5 | ||
| • Profondità coda arbitrato TX 6 | ||
| • Profondità coda arbitrato TX 7 |
eCPRI Intel FPGA IP v1.4.1
Tabella 3. v1.4.1 2022.07.01
| Versione Intel Quartus Prime | Descrizione | Impatto |
|
22.1 |
Aggiunto il design hardware esample il supporto per le variazioni del dispositivo Intel Agilex F-tile. Il disegno esample supporta i seguenti kit di sviluppo:
• Kit di sviluppo FPGA Intel Agilex serie I • Kit di sviluppo SoC ricetrasmettitore Intel Agilex serie I |
— |
| Aggiunto il supporto per il simulatore QuestaSim*. | — | |
| Rimosso il supporto per il simulatore ModelSim* SE. | — | |
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21.3 |
Aggiunto il supporto IP-XACT. | — |
| Problema risolto: impossibile rilevare l'elenco di riquadri per un dispositivo. | Nessuna selezione errata delle tessere. |
eCPRI Intel FPGA IP v1.4.0
Tabella 4. v1.4.0 2021.10.01
| Versione Intel Quartus Prime | Descrizione | Impatto |
|
21.2 |
Aggiunto il supporto per i dispositivi Intel Agilex F-tile. | — |
| Aggiunto supporto per progetti multicanale. | — | |
| Rimosso il supporto per il simulatore NCSim*. | — | |
| Problema risolto: il Streaming l'opzione non era disponibile quando si abilitava il Abbinalo a ORAN opzione nell'editor dei parametri IP. | Puoi abilitare o disabilitare il Streaming opzione quando il Abbinalo a ORAN il parametro è abilitato. |
eCPRI Intel FPGA IP v1.3.0
Tabella 5. v1.3.0 2021.02.26
| Versione Intel Quartus Prime | Descrizione | Impatto |
|
20.4 |
Aggiunto il supporto per i dispositivi Intel Agilex E-tile. | — |
| Aggiunto il supporto per l'impronta digitale 1588 PTP (larghezza 8 bit) come funzionalità standard. | Nessuna compatibilità con le versioni precedenti con la larghezza dell'impronta digitale PTP a 4 bit |
eCPRI Intel FPGA IP v1.2.0
Tabella 6. v1.2.0 2021.01.08
| Versione Intel Quartus Prime | Descrizione | Impatto |
|
20.3 |
Aggiunto il supporto per la funzione di interworking (IWF) di tipo 0. | È possibile connettere un nodo eCPRI con un nodo CPRI. |
| Supporta l'associazione di eCPRI Intel FPGA IP con O-RAN Intel FPGA IP. |
— |
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| Aggiunti i seguenti nuovi parametri relativi all'IWF:
• Supporto della funzione di interworking (IWF). • Tipo di funzione di interworking (IWF). • Funzione di interworking (IWF) Numero di CPRI |
Utilizzando questi parametri, puoi abilitare il tuo IP eCPRI per la funzionalità IWF. |
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| Aggiunte le seguenti interfacce relative a IWF:
• Interfaccia sorgente eCPRI IWF tipo 0 • Interfaccia sink eCPRI IWF tipo 0 • Interfaccia IWF Tipo 0 CPRI MAC Nota: Fare riferimento a eCPRI Guida per l'utente Intel FPGA IP per informazioni dettagliate sui segnali relativi a queste interfacce. |
— |
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| Aggiunti i seguenti segnali di clock:
• iwf_gmii_rxclk[N] • iwf_gmii_txclk[N] • gmii_rxclk[N] • gmii_txclk[N] |
— |
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| Aggiunti i seguenti segnali di reset:
• iwf_rst_tx_n • iwf_rst_rx_n • rst_tx_n_sync • primo_rx_n_sync • iwf_gmii_rxreset_n[N] • iwf_gmii_txreset_n[N] • gmii_rxreset_n[N] • gmii_txreset_n[N] |
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| La progettazione IP eCPRI esample per il dispositivo Intel Arria® 10 è ora disponibile. |
— |
eCPRI Intel FPGA IP v1.1.0
Tabella 7. v1.1.0 2020.05.18
| Versione Intel Quartus Prime | Descrizione | Impatto |
|
20.1 |
Aggiunto il supporto per i dispositivi Intel Arria 10. | — |
| L'IP supporta la velocità dati 10G per i dispositivi Intel Stratix® 10 e Intel Arria 10. | — | |
| Aggiunti i seguenti nuovi parametri:
• Streaming • Abbinalo a ORAN • Larghezza di bit del timer di misurazione del ritardo unidirezionale • Larghezza di bit del timer di accesso remoto alla memoria • Larghezza bit del timer di ripristino remoto |
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eCPRI Intel FPGA IP v1.0.0
Tabella 8. v1.0.0 2020.04.13
| Versione Intel Quartus Prime | Descrizione | Impatto |
| 19.4 | Versione iniziale. | — |
Archivi della guida per l'utente di Intel FPGA IP eCPRI
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Documenti / Risorse
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Intel eCPRI Intel FPGA IP [pdf] Manuale d'uso eCPRI Intel FPGA IP, eCPRI Intel, FPGA IP |
